实现 10 层全范德华单芯片三维系统，湖南大学团队新成果登《Nature》

IT之家 5 月 25 日消息，湖南大学 5 月 23 日发布公告，宣布其物理与微电子科学学院刘渊教授团队研发低温的范德华单芯片三维集成工艺，相关成果发表在《Nature》上。

相关背景介绍

三维集成是通过在垂直方向上将多个独立的芯片或功能层堆叠在一起的器件系统，能够实现逻辑、存储和传感等功能的垂直集成和协同工作，是后摩尔时代的重要技术路线。

目前商用的三维集成主要是通过封装技术将多芯片或者多芯粒垂直堆叠和互联。单芯片三维集成则是直接在同一芯片内部垂直集成多个器件层，通过将每一器件层直接制备在另一器件层之上，能够进一步提高芯片的互联密度和性能。

硅基单芯片三维集成面临着严重的热预算问题，其上层的硅沟道制备工艺会导致下层硅器件掺杂扩散和性能退化，限制了三维集成的发展。

团队方案

在该工艺中，源 / 漏 / 栅电极、层内互连金属、高 κ 栅介电质、低 κ 层间介电层和层间垂直通孔等电路功能层首先预制备在牺牲晶圆上，之后在 120 °C 的低温下范德华集成到半导体晶圆上。

通过逐层集成范德华预制备电路层和半导体层，团队实现了 10 层的全范德华单芯片三维系统。

该工艺优势

该集成工艺不会对底部的硫化钼晶体管电学性能产生影响，能够保证晶体管的本征性能，而且实现了逻辑、传感和存储互联的三维异质集成和协同工作。

IT之家附上参考地址

• 物电院刘渊教授团队在 Nature 发文报道单芯片三维集成研究新进展

• Monolithic three-dimensional tier-by-tier integration via van der Waals lamination

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